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# Correction TD2
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## 1 Etiquettes et index de cache
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1.1
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Index :
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(1) 2²¹ 2¹⁷ blocs (2²¹/2⁴) 17 bits\
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(2) 2²² (2²³/2⁵) 17 bits \
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(3) 2²² (2²²/(2⁵*4)) 15 bits
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Déplacement :
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(1) 4 bits (16 octets)\
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(2) 5 bits (32 octets)\
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(3) 5 bits
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Etiquette :
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(1) 31 - 4 - 17 = 10 bits \
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(2) 31 - 5 - 17 = 9 bits \
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(3) 31 - 5 - 15 = 11 bits
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1.2
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Etiquette :
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(1) 10 bits \
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(2) 9 bits \
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(3) 11 bits
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Ctl :
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(1) 1 (bit de validité)\
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(2) 1 + 1 (bit de réecriture)\
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(3) 1 + 1
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Ligne d'instruction ou de données :
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(1) 16 * 8 => 128 + 10 + 1\
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(2) 256 + 9 + 2 = 267 bits\
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(3) 256 + 11 + 2 = 269 bits
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Nombre total de bits du cache :
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(1) 2²¹ / 2⁴ = 128k soit 2¹⁷ * 139 = 17792 kbits\
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(2) 2²² / 2⁵ = 128k => 2¹⁷ * 267 = 34176 kbits\
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(3) 34432 kbits (accueille le meme nombre de lignes meme si 4 lignes par bloc)
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## 2 Caches données
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2.1
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(1) Correspondance directe
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(2) Associativité par 2
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Index :
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(1) 2¹³/2⁵ = 2⁸ 8 bits\
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(2) 7 bits
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Déplacement :
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(1)(2) 5 bits
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Pour que X et Y occupent le mot 0 de la ligne 0 il fut que l'index et le déplacement soient à 0. Soit (1) 13 bits / (2) 12 bits à 0.
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Donc un multiple de (1) 2¹³ | (2) 2¹².
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Soit :
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(1) X[0] et X[2048]\
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(2) X[0], X[1024], X[2048] et X[3072]
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2.2
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(1)\
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b1. X[0] et Y[0] commencent à l'index 0 et à chaque itération Y va écraser X. On a 2 défauts par itération.\
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b2. 4 défauts/it\
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b3. 2 défauts/it\
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b4. 3 déf/it si le compilateur est intelligent\
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(2)\
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b1. It 1 : 2 défauts puis cache hit => 1/4 déf/it
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b2. On a re 4 déf/it
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b3. 1/4 déf/it (Est-ce que le compilateur peut passer de b2 à b3 ?)\
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b4. 2 + 1/8 meilleur cas.
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